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Learn about unique transactions in the PCI bus, including parity calculations, error reporting, interruptions, special cycles, and exclusive lock operations. Understand how signals like PERR# and SERR# are used to handle data and address parity errors. Discover the protocol for managing interrupts and the rules for exclusive access on the bus. Enhance your knowledge of PCI bus intricacies with these detailed insights.
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LE BUS PCI5ième partie: Les transactions particulières Sommaire - Repère • Cinquième partie:Les transactions particulières • Parité, reporting d ’erreur • Les interruptions • Le cycle spécial • Lock operation / Accès exclusif Cours_bus_PCI_4_02
LE BUS PCI5ième partie: Les transactions particulièresParité, reporting d ’erreur • PAR • Parité paire calculée sur les 36 bits: AD[31::00] et C/BE#[3::0] • Master vers target pour les adresses et les données en écriture • Target vers master pour les données en lecture • Retardé d ’un cycle d ’horloge après que AD et C/BE# soient valides
LE BUS PCI5ième partie: Les transactions particulièresParité, reporting d ’erreur • Parité sur un cycle d ’écriture
LE BUS PCI5ième partie: Les transactions particulièresParité, reporting d ’erreur • Parité sur un cycle de lecture
LE BUS PCI5ième partie: Les transactions particulièresParité, reporting d ’erreur • Signaux supplémentaires • PERR# • Utilisé pour signaler une erreur de parité sur une donnée • Forcé par l ’agent qui reçoit la donnée • En retard sur PAR d ’un cycle d ’horloge • SERR# • Utilisé pour signaler une erreur de parité sur une adresse • Utilisé pour signaliser une erreur non récupérable • Entraîne un « crash » système • N ’a pas nécessairement une relation avec une opération sur le bus
LE BUS PCI5ième partie: Les transactions particulièresLes interruptions • Les Interruptions sont actives sur des niveaux (et non pas des fronts) bas • Les lignes INT# sont partagées • La plupart des configurations PCI ne requiert qu ’une seule interruption: Utiliser, dans ce cas, INTA# • La gestion des interruptions n ’est pas précisée dans la norme PCI
LE BUS PCI5ième partie: Les transactions particulièresLes interruptions
LE BUS PCI5ième partie: Les transactions particulièresLe cycle spécial • Commande utilisée quand le maître désire envoyer un message à plusieurs cibles • Type indiqué par le contenu AD[15:0]
LE BUS PCI5ième partie: Les transactions particulièresLock operation/ Accès exclusif
LE BUS PCI5ième partie: Les transactions particulièresLock operation / Accès exclusif
LE BUS PCI5ième partie: Les transactions particulièresLock operation / Accès exclusif
LE BUS PCI5ième partie: Les transactions particulièresLock operation / Accès exclusif
LE BUS PCI5ième partie: Les transactions particulièresLock operation / Accès exclusif
LE BUS PCI5ième partie: Les transactions particulièresLock operation / Accès exclusif
LE BUS PCI5ième partie: Les transactions particulièresLock operation / Accès exclusif
LE BUS PCI5ième partie: Les transactions particulièresLock operation / Accès exclusif
LE BUS PCI5ième partie: Les transactions particulièresLock operation / Accès exclusif
LE BUS PCI5ième partie: Les transactions particulièresLock operation / Accès exclusif
LE BUS PCI5ième partie: Les transactions particulièresLock operation / Accès exclusif
LE BUS PCI5ième partie: Les transactions particulièresLock operation / Accès exclusif • Seul le Master à l ’origine d ’un verrouillage d ’une Target peut y accéder • Le master ne peut accéder à aucun autre agent • Une Target verrouillée doit garantir que sa ressource concernée est effectivement verrouillée • La norme n ’impose à la Target que de verrouiller seulement 16 Octets alignés • La Target peut accepter des accès en dehors de sa ressource verrouillée • Il n ’est possible de verrouiller qu ’une seule Target à la fois