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Tomografia al Seno con Luce di Sincrotrone

Tomografia al Seno con Luce di Sincrotrone. F.Arfelli, A.Bergamaschi, D.Dreossi, R.Longo, A.Olivo, S.Pani, L.Rigon, C.Venanzi, E.Castelli. Informazione sulla profondita’ E’ assente la sovrapposizione delle strutture Applicata alla mammografia Ottimale per seni spessi e densi

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Tomografia al Seno con Luce di Sincrotrone

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Presentation Transcript


  1. Tomografia al Seno con Luce di Sincrotrone F.Arfelli, A.Bergamaschi, D.Dreossi, R.Longo, A.Olivo, S.Pani, L.Rigon, C.Venanzi, E.Castelli

  2. Informazione sulla profondita’ E’ assente la sovrapposizione delle strutture Applicata alla mammografia Ottimale per seni spessi e densi Permette di definire la forma delle lesioni Argomento di ricerca all’avanguardia fascio laminare oggetto rivelatore La tomografia

  3. Ottimizzazione energia Niente indurimento del fascio Assenza di artefatti Divergenza trascurabile Digitale indispensabile Alta efficienza Riduzione della dose Alta risoluzione Riduzione scattering Single photon counting Massimo contrasto MatisseMAmmographicandTomographic Imaging with Silicon detectors and Synchrotron radiation at Elettra Fascio laminare monocromatico di luce di sincrotrone Rivelatore digitale a microstrip

  4. Fenditure in vuoto Beam stopper Filtri Otturatori veloci Stazione mammografica SS FASCIO Elementi di controllo Elementi di sicurezza Fenditure in aria Camere a ionizzazione Monocromatore SELEZIONE FLUSSO E GEOMETRIA SELEZIONE ENERGIA SYRMA: La beam line per pazienti • Beam line modificata per esami su pazienti • Prime pazienti nel 2004 Setup tomografico gia’ predisposto

  5. L’upgrade della beam line Movimentazione lettino • Sistema di allineamento del detector • Sistema di controllo e sicurezza • Fast shutter • Sicurezza tomografica Posizionamento rivelatore

  6. Il rivelatore MATISSE • Geometria “edge on” • Alta efficienza • Alta risoluzione • Read Out a Single Photon Counting • Massimo contrasto • Segnali ridotti ( ~¼ MIP) • Richiesta alta velocita’

  7. Il progetto • Rivelatore finalizzato ad esami clinici • Integrazione nel sistema di controllo e sicurezza SYRMA

  8. Il rivelatore a microstrip • Pixel 100 x 300 µm2 • Lunghezza strip 2cm, Zona morta ridotta fino a 200µm Guard ring su 3 lati • Efficienza >70% • Bassa corrente di buio (0.1 nA/strip)

  9. L’elettronica di frontend • Alto guadagno • Almeno 100 mV/fC • Basso rumore • Poche centinaia di e- ENC • Alta velocita’ • 100% efficienza a 100 kHz/pixel • Piccolo ingombro • Matching con pitch 100 µm del detector

  10. Guadagno 100mV/fC 500 e- di rumore 75 ns peaking time Uscite digitali parallele VA64 LS64 FPGA VA64 + LS64

  11. Il Read Out Implementata mediante FPGA • Contatori paralleli a 16 bit • Shift register per il readout seriale • La lettura contemporanea all’’acquisizione e’ in fase di progettazione

  12. Crate VME 16 bit I/O register PC Linux Repeater Motori Pulse Generator Power supply Detector board Detector bias Il sistema di lettura MATwish controlla: • VME • Inizializzazione ASIC • Read Out da FPGA • GPIB • Movimentazione motori • Visualizzazione immagine

  13. ±2V 1.8V 3.3V 5V Il primo prototipo

  14. Bench tests Ingresso di calibrazione • 100% efficienza fino a 1MHz • Eccesso di conteggi • Doppi conteggi • Crosstalk

  15. Beam tests Osservati fotoni fino a 15 keV • Eccesso di conteggi • Eccesso di rumore stimato dagli scan

  16. Misura con Sorgente 241Am Grosso problema di cross-talk • Risolto in laboratorio

  17. Prime immagini con il prototipo a 64 canali (Luglio) Realizzazione di una nuova scheda di lettura Read Out senza tempi morti Realizzazione di una scheda a 4 ASIC Utilizzo FBGA Progettazione e realizzazione fast shutter Progettazione della meccanica di allineamento del rivelatore Attivita’ 2003 • Realizzazione e test del prototipo a 64 canali • Progettazione del sistema di acquisizione e sicurezza tomografico

  18. Attivita’ 2004 • Montaggio sistema di allineamento e integrazione del detector nel sistema di controllo della beam line • Realizzazione di una tomografia in modalita’ paziente con prototipo a 256 canali (30/06/2004) • Implementazione definitiva della logica di lettura (30/06/2004) • Realizzazione di una probe card e test degli ASIC • Realizzazione scheda a 32 ASIC (2048 canali) (31/12/2004)

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